74LS74中文资料_数据手册_参数

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74LS74双正边沿触发的D触发器预设清除和补充输出一般描述该器件包含两个独立74LS74的正边沿触发器，带互补输出的带触发器 的D触发器INFORMA- D输入端上的触发器接受位置上的触发器，时钟脉冲前沿触发发生在A电压电平并且与转换时间不直接相关 时钟上升沿的数据可能是D输入端的数据在不影响时钟低或高时更改只要数据建立和保持时间不相等，输出就可以违反预置或清除 输入的低逻辑电平无论逻辑电平如何，设置或复位输出其他投入特征 ?备用军用太空装置（74LS74）能联系美国国家半导体销售办 事处分销商的规格连接图双列直插式封装 TLF6373 - 1订单号54LS74DMQB 54LS74FMQB 54LS74LMQB DM54LS74AJ DM54LS74AW DM74LS74AM或DM74LS74AN参见NS包装号E20A J14A M14A N14A或W14B功能表输入输出 PR CLR CLK D Q Q LH X X H大号 HL X X大号 H二 X X H H HH ü HH大号 HH ü二 H HH大号 X Q 0 Q 0 高逻辑电平 X E 低或高逻辑电平 低逻辑电平 你是 积极的过渡 ?这 种配置是不稳定的，即当预置时它不会持续并且清除输入返回到其非活动（高）级别 Q 0 E 在74LS74指示的输入条件建立之前，Q 的输出逻辑电平 C1995美国国家半导体公司
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