杭电计组实验8-实现R型指令的CPU设计实验

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实验报告

2018 年 6 月 1 日成绩：

);

initial begin

// Initialize Inputs

rst = 0;

clk = 0;

// Wait 100 ns for global reset to finish

#100;

clk=1;

// Add stimulus here

forever

begin

#50;

clk=~clk;

end

end

endmodule

二、仿真波形

三、电路图

顶层电路模块

顶层电路内部结构：